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1 | Revision Date | Change Description | ||||||||||||||||||||||||
2 | 5/8/2018 | Alinged on 260p connector. | ||||||||||||||||||||||||
3 | 5/8/2018 | remove hbled signal. Will keep this onboard mezzanine. Instead will use BOOT_IND#, active low signal indicating SOC has booted. | ||||||||||||||||||||||||
4 | 5/8/2018 | lowered UART total interfaces to 4x. 2x of them have RTS/CTS signals | ||||||||||||||||||||||||
5 | Fixed the 1.8v eSPI or 3.3v for LPC | |||||||||||||||||||||||||
6 | added net vbus sense and fixed net names, took away from a GPIO. USB2APWREN_GPIO USB2BVBUSSNS_GPIO USB2AVBUSSNS_GPIO | |||||||||||||||||||||||||
7 | 5/14/2018 | Changed net names to better describe net names | ||||||||||||||||||||||||
8 | 5/14/2018 | Changed two UART primary flow control signals to secondary function for GPIOS | ||||||||||||||||||||||||
9 | 6/12/2018 | Fixed netname priority for GPIO_RGMIIMDC and GPIO_RGMIIMDIO to have GPIO come first | ||||||||||||||||||||||||
10 | 6/13/2018 | Removed 2nd JTAG interface. | ||||||||||||||||||||||||
11 | 6/13/2018 | Moved USB host and USB device into its own general function for general pin count tab | ||||||||||||||||||||||||
12 | 6/13/2018 | Changed USB host net name from USB2AVBUSSNS to USB2AOC (Over current) | ||||||||||||||||||||||||
13 | 6/13/2018 | Reduced UARTs from 5 to 3. Moved the 4 extra signals to GPIO | ||||||||||||||||||||||||
14 | 6/13/2018 | Changed a UART netname to "CONSOLE" instead of UART | ||||||||||||||||||||||||
15 | 6/13/2018 | Increased to 16 I2C bus's. 4 are now secondary function instead of GPIOs. | ||||||||||||||||||||||||
16 | 6/14/2018 | Added quad mode support for both FW SPI and SPI1 interface. SIO[0:3] support as secondary function | ||||||||||||||||||||||||
17 | 6/15/2018 | Fix net naming errors for 1GbT signals | ||||||||||||||||||||||||
18 | 6/18/2018 | IO0/MOSI and IO1/MISO per standard - switched the SPI SIGNALS | ||||||||||||||||||||||||
19 | 6/21/2018 | Changed a few descriptions, updated SIOPWREQ to SIOPME. Swapped PECI signals (wrong descriptions; only these were swapped) | ||||||||||||||||||||||||
20 | 7/4/2018 | Added column for runBMC aspeed naming on schematic | ||||||||||||||||||||||||
21 | 7/5/2018 | Removed reset from PWRGD. This is an input only for monitoring PSUs | ||||||||||||||||||||||||
22 | 7/5/2018 | SIO netnames need to have a "#" to reflect active low | ||||||||||||||||||||||||
23 | 8/14/2018 | Removed active low "#" for INDICATOR | ||||||||||||||||||||||||
24 | 8/14/2018 | Changed pinout reordering | ||||||||||||||||||||||||
25 | 8/14/2018 | INDICATOR is secondary option instead of primary | ||||||||||||||||||||||||
26 | 8/14/2018 | BMC_RST_N_CONN to BMC_RESET# | ||||||||||||||||||||||||
27 | 8/14/2018 | Add secondary function for KLUDGE as GPIO | ||||||||||||||||||||||||
28 | 8/14/2018 | Addended the net names that had VDD with _STBY | ||||||||||||||||||||||||
29 | 8/15/2018 | Moved Indicator to pin 109 | ||||||||||||||||||||||||
30 | 8/15/2018 | SIOPWREQ was actualyl SIPME# | ||||||||||||||||||||||||
31 | 8/15/2018 | 229, 231, and 241, 243 pins were swapped due to routing concenrs. Planning to swap these back for consitency. | ||||||||||||||||||||||||
32 | 9/17/2018 | For SYSSPI signals we have made these primary function (GPIO is second function). The Indicator and WP signals have been moved | ||||||||||||||||||||||||
33 | 9/26/2018 | Added secondary functions for GPIOs. These will be UARTS (RX, TX). Pins 144, 146, 148, 150 are updated on pinout. Pinout namings also updated | ||||||||||||||||||||||||
34 | 10/2/2018 | Removed secondary functionality for FWSPI pins; now act as FWSPI only (no GPIO secondary or primary function) RGMIIRXCK for connector no longer has GPIO functionality | ||||||||||||||||||||||||
35 | 10/18/2018 | Added pinout for MiniSAS HD Connector on BUV | ||||||||||||||||||||||||
36 | 11/15/2018 | Changed Pin 2 from VDD_1V8_STBY to VDD_IO_REF. This is now an output voltage used for reference i/o, low current | ||||||||||||||||||||||||
37 | 11/15/2018 | Updated the direction for the pinout naming tab. | ||||||||||||||||||||||||
38 | 11/15/2018 | Changed USB2A primary descrioption as host | ||||||||||||||||||||||||
39 | 11/15/2018 | Changed USB net names to include HD (host) and D (Device) to be more descriptive | ||||||||||||||||||||||||
40 | 11/15/2018 | Changed BMCLPC3V3_BMCESPI1V8 to VDD_LPC3V3_ESPI1V8 | ||||||||||||||||||||||||
41 | 11/15/2018 | For runBMC_v2_260p_sodimm_pinouts, for System SPI, added IO0 to MOSI and IO1 to MISO (these changes were in the pinout naming but not in the sodimm pinout) | ||||||||||||||||||||||||
42 | 11/15/2018 | Added System SPI pins to the runBMC_pinout_naming sheet (they were missing before), 4 GPIOs were removed | ||||||||||||||||||||||||
43 | 11/15/2018 | Added UART3 & UART4 TX&RX pins, removed 4 GPIOs | ||||||||||||||||||||||||
44 | 11/15/2018 | Removed hardware flow control for UART1 & UART2, 4 GPIOs were added | ||||||||||||||||||||||||
45 | 11/15/2018 | Removed SIOPME signal, 1 GPIO added | ||||||||||||||||||||||||
46 | 11/15/2018 | Renamed "Primary" and "Secondary" to "Function 1" and "Function 2", since we are now describing two types of pins; dedicated function and dual function | ||||||||||||||||||||||||
47 | 11/15/2018 | ADC [8-15] is GPI only. | ||||||||||||||||||||||||
48 | 11/15/2018 | Changing the following GPIOs to GPO's only. GPIO_SPI1_IO2, SYSMISO_GPIO, SYSMOSI_GPIO, SPI1MISO_GPIO, SPI1MOSI_GPIO, UART1TX_GPIO to only be GPO | ||||||||||||||||||||||||
49 | 11/15/2018 | Back annotation of runBMC_v2_260p_sodimm_pinouts to make sure GPIOs are in ascending order | ||||||||||||||||||||||||
50 | 11/29/2018 | Change PECI pin to have no alternate functionality (on General Pin Count tab) | ||||||||||||||||||||||||
51 | 11/29/2018 | I2C13 is connected to ID FRU, so I2C13 should not be dual function. Updated General Pin Count Tab & runBMC_pinout_naming tab | ||||||||||||||||||||||||
52 | 11/29/2018 | Removed SIOONCTRL from General Pin Count & runBMC_pinout_naming | ||||||||||||||||||||||||
53 | 12/8/2019 | Added GPIO as 2nd function for RGMIIRXCK | ||||||||||||||||||||||||
54 | 12/8/2019 | Removed duplicate UARTs in GPIOI blocks for UART3 and UART4 | ||||||||||||||||||||||||
55 | 12/8/2019 | Added clear description for USB host/device pinout description | ||||||||||||||||||||||||
56 | 1/9/2019 | Changed VDD_IO_REF netname to VDD_RGMII_REF | ||||||||||||||||||||||||
57 | 1/10/2019 | Locked Revision 1.0!! | ||||||||||||||||||||||||
58 | 2/21/2019 | UNLOCKED | ||||||||||||||||||||||||
59 | 2/21/2019 | Changed some color scheming in the runBMC_v2_260p_sodimm_pinouts tab to be higher contrast | ||||||||||||||||||||||||
60 | 4/15/2019 | Changed Kludge to CPU_RST#. CPU_RST# is the PCH reset or AMD/CPLD reset output | ||||||||||||||||||||||||
61 | 5/7/2019 | Changed Klugde_GPIO65 to RESERVED_GPIO65. Removed Kludge language | ||||||||||||||||||||||||
62 | 8/6/2019 | Added Pass-Through pins to some GPIOs, I2C9 is now the interal FRU bus. This means GPIOs had to be incremented by 2, change on pins 47 to 183 | ||||||||||||||||||||||||
63 | 8/6/2019 | Locked Revision 1.4 | ||||||||||||||||||||||||
64 | 1/24/2021 | Draft of v1.5 | ||||||||||||||||||||||||
65 | 1/24/2021 | Added new tab for v1.5 pinout proposal and changelist discussion | ||||||||||||||||||||||||
66 | 1/24/2021 | Change pin name from CPU_RST# to PLT_RST# | ||||||||||||||||||||||||
67 | 1/24/2021 | Add pin95(GPIO63) to be BMC_PWRGD(output) | ||||||||||||||||||||||||
68 | 1/24/2021 | Add one more reset input pin on pin93(GPIO61) as PFR_RST# | ||||||||||||||||||||||||
69 | 1/24/2021 | Add SD interface (pin 141,143,187,189,199,201,48,50) | ||||||||||||||||||||||||
70 | 1/24/2021 | Add I3C interace (pin 123,125,205,207,128,130,134,136) | ||||||||||||||||||||||||
71 | 1/25/2020 | Updated Changelist Discussion Tab | ||||||||||||||||||||||||
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